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https://di.univ-blida.dz/jspui/handle/123456789/10102
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Élément Dublin Core | Valeur | Langue |
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dc.contributor.author | RAIS, Chahinez Imene | - |
dc.contributor.author | Allaoui, Ilhem | - |
dc.date.accessioned | 2021-02-23T09:34:41Z | - |
dc.date.available | 2021-02-23T09:34:41Z | - |
dc.date.issued | 2020 | - |
dc.identifier.uri | http://di.univ-blida.dz:8080/jspui/handle/123456789/10102 | - |
dc.description | 4.621.1.792 ; 103 p ; illustré | fr_FR |
dc.description.abstract | Les travaux présentés dans ce mémoire portent, essentiellement, sur la conception et la simulation sous Matlab et par la suite l’implémentation sur FPGA (Field Programmable Gate Array) ; d’un circuit intégré dédié à la classification des arythmies cardiaques par l’approche des réseaux de neurones. Afin de pouvoir classer un nombre d’arythmies, nous proposons un classificateur de morphologie. Pour réaliser la classification, nous utilisons l’apprentissage par l’algorithme de la rétropropagation du gradient (RPG). La partie software a pour tâche essentielle de réaliser l’apprentissage du classificateur sous neural network toolbox (NNTool) de Matlab. Nous présentons les résultats de classification obtenus sur la base de donnés « QT-Database ». La partie hardware propose une architecteur parallèle pour l’implémentation du réseau de neurones. Afin de valider cette architecture nous avons opté pour l’utilisation du langage de description VHDL sous l’environnement VIVADO de XILINX. La description VHDL du classificateur est implémentée sur un circuit FPGA de la famille Artix 7. | fr_FR |
dc.language.iso | fr | fr_FR |
dc.subject | classification, arythmies cardiaques, QT-Database, réseau de neurones, implementation FPGA. | fr_FR |
dc.title | Conception d’un classificateur des arythmies cardiaques à base des réseaux de neurones et son implémentation sur FPGA | fr_FR |
Collection(s) : | Mémoires de Master |
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Fichier | Description | Taille | Format | |
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