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https://di.univ-blida.dz/jspui/handle/123456789/12761
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Élément Dublin Core | Valeur | Langue |
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dc.contributor.author | Anane, Walid | - |
dc.contributor.author | Terrati, Lyes | - |
dc.date.accessioned | 2021-11-07T07:52:52Z | - |
dc.date.available | 2021-11-07T07:52:52Z | - |
dc.date.issued | 2021 | - |
dc.identifier.uri | http://di.univ-blida.dz:8080/jspui/handle/123456789/12761 | - |
dc.description | 621.1040 ; 65 p | fr_FR |
dc.description.abstract | La complexité des applications de traitement de données dans les ordinateurs nécessite de plus en plus de mémoire pour que le système fonctionne, il y a donc une bonne demande pour des mémoires de grandes capacités avec une efficacité plus élevée. Il est plus souhaitable que les mémoires informatiques soient plus efficaces et coûtent moins cher. Le traitement des données ainsi que le stockage en mémoire statique se sont avérés adaptés aux opérations nécessitant un temps d'accès réduit. Une telle approche de la conservation des données volatiles est le concept des mémoires statiques à six transistors. Dans ce projet, nous étudions la conception de base de la mémoire statique volatile tout en décrivant les différentes propriétés de la mémoire informatique. Le travail est basé sur les outils DSCH 3.5 et Microwind 3.5. Nous utilisons une conception simulée pour les circuits électrique ainsi que les masques, nous étudions également une mémoire 4X4 en utilisant notre cellule SRAM proposée qui ne nécessite que six transistors par rapport aux conceptions utilisant des portes logiques qui sont moins efficaces et prennent plus de place car elles nécessitent un nombre de transistors plus élevé | fr_FR |
dc.language.iso | fr | fr_FR |
dc.publisher | Univ Blida1 | fr_FR |
dc.subject | Mémoire statique . ; Masques . ; Portes logiques ; Transistors | fr_FR |
dc.title | Etude et simulation d’une RAM 4x4 bits | fr_FR |
Collection(s) : | Mémoires de Master |
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